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Resumen
Esse artigo apresenta o processo de desenvolvimento de um processador MIPS de 32 bits com funcionalidades reduzidas. Para isso, utiliza-se de conceitos de computação reconfigurável, por meio da sintetização em Field Programmable Gate Array (FPGA) com o uso da linguagem VHDL para descrição do hardware. O resultado desse projeto poderá ser utilizado como material didático em disciplinas relacionadas, além de oferecer um IP validado do processador MIPS 32 bits, fomentando assim o desenvolvimento de variados projetos de pesquisa na área de microeletrônica, arquitetura de computadores e linguagens de descrição de hardware.
Palavras-chave:
Abstract
Development of aprocessor based in MIPS32 architecture using reconfigurable hardware
This paper presents the process of developing a 32-bit MIPS processor with reduced functionality, using concepts of reconfigurable computing through the synthesis on Field Programmable Gate Array (FPGA) using VHDL language to describe the hardware. The result of this project could be used as teaching material in related disciplines, besides offering a validated IP of MIPS 32 bits processor, which can be further used as part of various research projects in microelectronics, computer architecture and hardware description languages.
Keywords: MIPS. FPGA. Reconfigurable Hardware. VHDL.
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